郑 鑫，闫钧华

（1.光电控制技术重点实验室 河南 洛阳 471009；2.南京航空航天大学 江苏 南京 210016）

航空电子图像处理系统为操作者提供各种图像及字符信息，随着传感器、显示器的性能指标不断提升，图像处理系统的设计面临越来越大的挑战，其中图像缩放的功能是图像处理系统的关键技术要求。图像缩放功能有两种实现方案：1）软件实现，其优点是算法选择灵活多样，生成的画面质量较高，缺点是运算时间长。2）硬件实现，其优点是分辨率高，实时性强，缺点是不易实现功能强大的优秀算法。

近年来，FPGA技术发展迅速，片内集成了PLL、硬件乘法器、存储器，具有了实现优秀算法的充足资源[1]。许多航空电子嵌入式图像处理系统是由固定的视频源和显示设备组成，系统中图像缩放的倍率是固定的。文中针对此展开重点研究，基于FPGA硬件，实现固定倍率的图像缩放。

1 图像缩放的算法

数字图像的缩放是一个处理2维离散信号的过程。输出图像中任一个像素F（x，y），均可以在输入图像f（x，y）的像素矩阵中找到其对应的位置，如图1所示。

F（x，y）的值可以对其邻域的原始图像进行二维卷积运算得到。

图1 输入和输出图像像素的映射关系Fig.1 Pix mapping of input and output image

其中m×n为邻域范围，f（i，j）是输入原始图像，s（i，j）为系数函数。

因为图像中邻近的像素存在着相关性，所以输出图像像素可以依据其在原始输入图像映射位置邻域的像素数据卷积得到。邻域范围内各个像素的相关度由系数函数决定，邻域的范围决定了算法的运算速度[2-3]。……